FPGA開發(fā)工程師
面議
成都
應(yīng)屆畢業(yè)生
學(xué)歷不限
成都
應(yīng)屆畢業(yè)生
學(xué)歷不限
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
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職位描述
該職位信息待核驗(yàn)，請(qǐng)仔細(xì)了解后再進(jìn)行投遞！
崗位職責(zé)
1． 負(fù)責(zé)硬件數(shù)字電路芯片選型及原理圖設(shè)計(jì)；
2． 負(fù)責(zé)FPGA邏輯電路設(shè)計(jì)：Verilog代碼編寫、仿真、調(diào)試；
3． 負(fù)責(zé)單板及系統(tǒng)整機(jī)聯(lián)調(diào)的工作；
4． 相關(guān)開發(fā)文檔的整理與編寫。
任職要求
1． 精通高速ADC、DAC、DDS、ALTERA和XILINX FPGA等器件工作原理和電路設(shè)計(jì)；
2． 熟練掌握單片機(jī)、ARM的工作原理和電路設(shè)計(jì)，會(huì)設(shè)計(jì)簡(jiǎn)單的上位機(jī)程序。
3． 熟練掌握行業(yè)主流電路設(shè)計(jì)工具，多層PCB布線經(jīng)驗(yàn)；
4． 熟練使用Verilog進(jìn)行代碼編寫、仿真、時(shí)序約束和調(diào)試。
1． 負(fù)責(zé)硬件數(shù)字電路芯片選型及原理圖設(shè)計(jì)；
2． 負(fù)責(zé)FPGA邏輯電路設(shè)計(jì)：Verilog代碼編寫、仿真、調(diào)試；
3． 負(fù)責(zé)單板及系統(tǒng)整機(jī)聯(lián)調(diào)的工作；
4． 相關(guān)開發(fā)文檔的整理與編寫。
任職要求
1． 精通高速ADC、DAC、DDS、ALTERA和XILINX FPGA等器件工作原理和電路設(shè)計(jì)；
2． 熟練掌握單片機(jī)、ARM的工作原理和電路設(shè)計(jì)，會(huì)設(shè)計(jì)簡(jiǎn)單的上位機(jī)程序。
3． 熟練掌握行業(yè)主流電路設(shè)計(jì)工具，多層PCB布線經(jīng)驗(yàn)；
4． 熟練使用Verilog進(jìn)行代碼編寫、仿真、時(shí)序約束和調(diào)試。
注：聯(lián)系我時(shí)，請(qǐng)說是在四川人才網(wǎng)上看到的。
工作地點(diǎn)
地址：成都郫都區(qū)郫都區(qū)成都晶寶時(shí)頻技術(shù)股份有限公司二樓
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詳細(xì)位置，可以參考上方地址信息
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職位發(fā)布者
商女士HR
成都晶寶時(shí)頻技術(shù)股份有限公司
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電子·微電子
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100-199人
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股份制企業(yè)
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成都市高新區(qū)西部園區(qū)百葉路8號(hào)
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